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Technologie de processus 0,35 µm : ce que c'était et pourquoi ça comptait

Définition

Processus 0,35 µm (350 nm) = longueur de grille minimale tracée (Lmin) de 0,35 micromètres dans un flux de fabrication CMOS. Il définissait la densité de transistors, la vitesse et la tension pour les CI du milieu des années 90.

Contexte historique

NœudAnnée introVDD (cœur)Produits phares
0,8 µm19905 V486 DX2, ASICs précoces
0,5 µm19933,3 VPentium (P5), PowerPC 601
0,35 µm19953,3 V → 2,5 VPentium Pro, K6, StrongARM, DSPs précoces
0,25 µm19982,5 V → 1,8 VPentium II/III, K7, G4

Caractéristiques techniques clés

  • 3–4 couches métal (Al ou Cu damascène précoce).
  • Source/Drain + Grille salicidés (Salicide) pour Rsd faible.
  • STI (Isolation par tranchées peu profondes) remplaçant LOCOS — meilleure densité.
  • Oxyde de grille double : Fin (6–7 nm) pour cœur, épais (12–15 nm) pour E/S (tolérance 5 V).
  • Limite réticule : ~25 mm × 25 mm → puce max ~600 mm².

Pourquoi c'était un « sweet spot »

  • Dernier nœud où l'E/S 5 V cohabitait aisément avec cœur 3,3 V — idéal pour le mixte-signal (ADC, DAC, PMIC).
  • Mature, haut rendement, faible densité de défauts — encore utilisé aujourd'hui pour MCU auto, gestion de puissance, RF BiCMOS, CI haute tension.
  • Coût jeu de masques ~200k–500k $ (vs 10 M$+ à 7 nm) — économique pour volumes 10k–1M unités.

Variantes modernes 0,35 µm

  • 0,35 µm HV (Haute Tension) : 20–700 V DMOS/LDMOS pour drivers, PMICs.
  • 0,35 µm BCD (Bipolaire-CMOS-DMOS) : Analogique précision + commutateurs de puissance.
  • 0,35 µm SiGe BiCMOS : Front-end RF (Wi-Fi, Bluetooth, 5G sub-6).

Fonderies offrant encore du 0,35 µm

TSMC (0,35 µm HV/BCD), GlobalFoundries (0,35 µm LP/HV), Tower Semiconductor (0,35 µm SiGe), X-Fab (0,35 µm HV), ON Semi, Infineon (interne).

Le 0,35 µm n'est pas « obsolète » — c'est le nœud cheval de bataille pour le mixte-signal et les CI de puissance où la tolérance 5 V, la précision analogique et le coût des masques priment sur le nombre de transistors.

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