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Inconvénients de la technologie VLSI

L'intégration à très grande échelle (VLSI) intègre millions à milliards transistors sur une seule puce, permettant l'informatique moderne. Cependant, elle introduit défis ingénierie et économiques significatifs.

Principaux inconvénients

  1. Coût capital & NRE élevé : Fondeuse pointe (3 nm/5 nm) >20 Md$ ; jeux masques 10–50 M$ ; licences outils EDA 1 M$/an+ par siège.
  2. Complexité conception : SoCs milliards transistors nécessitent réutilisation IP hiérarchique, vérification formelle, émulation, fermes simulation massives (milliers cœurs).
  3. Densité puissance & gestion thermique : >100 W/cm² cœurs haute perf ; nécessite packaging avancé (empilement 3D, chiplets, refroidissement liquide) et DVFS.
  4. Goulot vérification : Couverture fonctionnelle closure prend 60–70 % temps projet ; méthodes formelles/assertions aident mais n'éliminent pas simulation.
  5. Limites mise à l'échelle physique : Tunnel quantique, rugosité bords, variabilité, délai RC limitent scaling Dennard ; nouvelles archi (GAA, CFET, 3D) ajoutent coût.
  6. Rendement fabrication : Densité défauts ~0,05–0,1/cm² ; grosses puces (>600 mm²) nécessitent redondance (cœurs secours, ECC) ou désagrégation chiplets.
  7. Obsolescence rapide : Cycles conception 2–3 ans ; tape-out à volume 12–18 mois ; risque raté specs ou shift marché.
  8. Facteurs stress fiabilité : Électromigration, TDDB, BTI, HCI, SEU — s'aggravent hautes temp/voltages ; nécessitent guard-banding.
  9. Surface sécurité : Chevaux de Troie matériels, canaux auxiliaires (Spectre/Meltdown), attaques chaîne approvisionnement firmware ; atténuation ajoute overhead surface/puissance.

Stratégies atténuation

  • Chiplet / intégration hétérogène (AMD EPYC, Intel Foveros, UCIe).
  • EDA open-source (OpenROAD, Yosys) et RISC-V pour réduire licences.
  • Placement-routage piloté IA, synthèse analogique, génération tests.
  • Design-for-Test (DFT), Built-In Self-Test (BIST), surveillance cycle vie silicium (AVS).

Le VLSI reste seule voie vers électronique haute perf, basse conso — mais barrière entrée monte chaque nœud.

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